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蘇州思得普申請基于可視化圖形設(shè)計平臺的FPGA開發(fā)方法及系統(tǒng)專利,助力實現(xiàn)高效的FPGA開發(fā)

2025-1-22 12:45| 發(fā)布者: admin| 查看: 60| 評論: 0
摘要: 金融界2025年1月22日消息,國家知識產(chǎn)權(quán)局信息顯示,蘇州思得普信息科技有限公司申請一項名為“基于可視化圖形設(shè)計平臺的FPGA開發(fā)方法及系統(tǒng)”的專利,公開號CN 119272682 A,申請日期為2024年9月。專利摘要顯示,本 ...

金融界2025年1月22日消息,國家知識產(chǎn)權(quán)局信息顯示,蘇州思得普信息科技有限公司申請一項名為“基于可視化圖形設(shè)計平臺的FPGA開發(fā)方法及系統(tǒng)”的專利,公開號CN 119272682 A,申請日期為2024年9月。

專利摘要顯示,本發(fā)明提供基于可視化圖形設(shè)計平臺的FPGA開發(fā)方法及系統(tǒng),涉及可視化圖形技術(shù)領(lǐng)域,包括根據(jù)Verilog語言中的模塊定義建立可視化圖形模塊,在設(shè)計界面中提供包含邏輯門模塊、組合邏輯模塊和時序邏輯模塊的電路模塊庫;通過拖拽方式將所需的可視化圖形模塊從所述電路模塊庫添加到電路視圖中;獲取所有模塊信息,生成以模塊ID為索引的模塊線性查找表,將模塊參數(shù)、端口、內(nèi)部行為級語句和數(shù)據(jù)流語句轉(zhuǎn)換為代碼;生成相應(yīng)的Verilog代碼,包括參數(shù)聲明代碼、端口聲明代碼、連線代碼和模塊代碼;對子模塊遞歸執(zhí)行上述Verilog代碼生成步驟,直至完成所有模塊的代碼轉(zhuǎn)換;將生成的所有Verilog代碼整合,形成完整的FPGA設(shè)計代碼。

天眼查資料顯示,蘇州思得普信息科技有限公司,成立于2016年,位于蘇州市,是一家以從事軟件和信息技術(shù)服務(wù)業(yè)為主的企業(yè)。企業(yè)注冊資本200萬人民幣。通過天眼查大數(shù)據(jù)分析,蘇州思得普信息科技有限公司參與招投標(biāo)項目5次,知識產(chǎn)權(quán)方面有商標(biāo)信息4條,專利信息3條,此外企業(yè)還擁有行政許可4個。

本文源自金融界

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